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11.5.2 Register Description
Register 0x04 (TRX_CTRL_1):
The TRX_CTRL_1 register is a multi-purpose register to control various operating
modes and settings of the radio transceiver.
Figure 11-16 . Register TRX_CTRL_1.
Bit
7
6
5
4
0x04
Read/Write
Reset value
Bit
reserved
R/W
0
3
IRQ_2_EXT_EN
R/W
0
2
TX_AUTO_CRC_
ON
R/W
1
1
RX_BL_CTRL
R/W
0
0
TRX_CTRL_1
0x04
SPI_CMD_MODE
IRQ_MASK_MODE
IRQ_POLARITY
TRX_CTRL_1
Read/Write
Reset value
R/W
0
R/W
0
R/W
1
R/W
0
? Bit 4 - RX_BL_CTRL
The register bit RX_BL_CTRL controls the Frame Buffer Empty Indicator.
Table 11-16. RX_BL_CTRL.
Register Bits
RX_BL_CTRL
Value
0
1
Description
Frame Buffer Empty Indicator disabled
Frame Buffer Empty Indicator enabled
Note:
1.
A modification on IRQ_POLARITY bit has no influence to RX_BL_CTRL behavior.
If this register bit is set the Frame Buffer Empty Indicator is enabled. After sending a
Frame Buffer read command, refer to Section 6.2 , pin 24 (IRQ) indicates to the
microcontroller that an access to the Frame Buffer is not possible as long as valid
PSDU data are missing.
The pin 24 (IRQ) does not indicate any interrupts during this time.
142
AT86RF232
8321A – MCU Wireless – 10/11
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